颀中科技2.5D封装产品获客户送样验证，2024Q4正式量产_CPU

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5. #华为芯片##中国芯片走出不同于西方的路#华为提出“τ定律”，真正重要的是什么？很多人看到“τ定律”，第一反应是： “是不是中国芯片追不上先进制程了？” 其实不完全是。更重要的是：全球芯片行业本身，也在发生方向变化。因为现在整个行业都发现：继续缩小晶体管，收益正在下降。但AI时代又需要更高性能。怎么办？于是行业开始转向：系统级优化。包括： * Chiplet * 3D封装 * 光互连 * 异构计算 * 软件硬件协同而“τ定律”的意义，其实是在试图给这种趋势建立一套新的理论框架。它想表达的是：未来性能提升，不一定来自“更小”，也可能来自： “更快的信息流”。这是一次很典型的：从“空间思维”，转向“时间思维”。

6. #苹果M5Pro和Max或为同款芯片# 最新爆料显示，苹果 M5 Pro 与 M5 Max 并非两款独立芯片，而是采用全新 2.5D 封装技术的同一款芯片，可灵活拆分 CPU、GPU 核心，配置选配更自由。该设计能有效节省成本、提升良品率，仅顶配 GPU 与内存需选择 M5 Max 版本消息称苹果 M5 Pro 和 M5 Max 为同一款芯片不同版本，采用全新 2.5D 封装工艺

7. 【#苹果M5Pro芯片封装前瞻#】2 月 19 日消息，苹果已官宣 3 月 4 日举办新品发布会，预计将推出搭载 M5 Pro 和 M5 Max 芯片的新款 MacBook Pro。本次芯片升级的核心亮点在于变革封装技术：苹果将放弃传统的 InFO 封装，转而采用台积电 2.5D 芯粒（Chiplet）设计。InFO 是苹果常用的一种封装技术，特点是很薄、成本相对较低，适合手机和轻薄本。但随着芯片越来越大、越来越热，这种技术有点“包不住”了，限制了核心数量进一步增加。随着晶体管密度增加，单片架构的弊端日益显现，14 英寸 M4 Max 用户对此或许深有体会。由于 CPU 和 GPU 紧密相邻，高负载下会产生显著的“热串扰”现象：即 GPU 发热会直接导致 CPU 升温，反之亦然，且两者无法独立散热。此外，复杂的供电走线在狭小空间内极易产生信号干扰，导致电能难以从芯片边缘无损传输至中心区域，限制了性能释放。苹果的 M5 Pro 和 M5 Max 预计将迎来 M1 发布以来的最大技术变革，首次采用台积电 SOIC-MH 2.5D 封装技术。SOIC-MH 是台积电的一种先进芯片 3D 堆叠技术，就像把原本平铺在一张大饼上的配料（CPU / GPU），切开后重新精细地码放在一个盘子里，既保持了整体性，又让各部分互不干扰。而 2.5D 封装是一种把“积木”拼在一起的高级胶水技术，它不仅仅是把芯片平铺，而是在芯片和电路板之间加了一层“中介层”（Interposer），让这些芯粒之间能以极高的速度传输数据，仿佛它们本来就是一体的。SOIC-MH 技术通过将 CPU 和 GPU 拆解为独立的“芯粒”，并封装在同一个基板（Substrate）上来解决上述难题。这种物理隔离消除了热量和电气的相互污染，让 CPU 和 GPU 能够拥有独立的供电通道和散热环境。尽管物理上分离，但借助先进的互连技术，这些芯粒在逻辑上仍表现为一颗完整的芯片，保留了 SoC 架构低延迟、高响应的核心优势。架构分离还为苹果带来了巨大的成本优势。在传统模式下，若 M4 Max 的 GPU 部分存在缺陷，整颗芯片可能都需要降级甚至报废。而在芯粒架构下，苹果可以分级筛选（Binning）CPU 和 GPU 模块。这意味着，拥有完美 CPU 但 GPU 稍弱的模块可以灵活组合，无需因局部瑕疵而牺牲整体，从而大幅提升晶圆利用率，也为未来增加更多核心数量提供了经济上的可行性。值得注意的是，这项昂贵的先进封装技术将由 Pro 和 Max 系列独占，标准版 M5 芯片预计将继续使用传统的 InFO（集成扇出型）封装技术。得益于散热与抗干扰能力的提升，M5 Pro 和 M5 Max 有望突破前代产品的规格天花板。回顾 M3 Max 和 M4 Max，受限于旧有的封装技术，其规格一直被锁定在最高 14 核 CPU 和 40 核 GPU。随着 2.5D 芯粒设计的引入，苹果终于能够在新一代芯片中塞入更多的 CPU 和 GPU 核心，为专业用户提供更强劲的计算与图形处理能力，而无需担心过热降频。（IT之家）

8. 台积电封装垄断格局悄然松动：SK海力士联手英特尔测试EMIB技术，AI芯片供应链或迎重大变局

9. 中芯国际成立先进封装研究院，正式官宣进入先进封装领域。台积电称这个业务领域为Fab2.0。研究公司Yole Group《Status of the Advanced Packaging Industry 2025》报告显示，2024年全球先进封装市场达519亿美元（同比增10.9%），2025年预计增至569亿美元（同比增9.6%），2030年有望突破794亿美元，2024-2030年复合增长率约19%。

10. 华为提出的“韬（$\\tau$）定律”与摩尔定律，以及现有的2.5D、3D堆叠技术之间，存在着紧密的代际承接、范式转换以及技术深化的关系。以下为您深度解析它们之间的底层逻辑联系：### **一、韬定律与摩尔定律的关系：从“几何缩微”到“时间缩微”的范式转移**传统半导体产业遵循的“摩尔定律”与华为提出的“韬定律”，本质上是解决芯片性能提升的两种不同维度维度的指导思想：1. **摩尔定律（物理尺寸驱动）**： * **核心逻辑**：通过“几何缩微”（Geometric Scaling），即不断缩小晶体管的物理尺寸，从而在单位面积内塞入更多的晶体管。在摩尔定律的黄金时代，晶体管变小不仅提升了密度，还缩短了电学通路，从而使信号传播时延（即特征时间常数 $\\tau$）自然降低。 * **面临的壁垒**：当制程逼近纳米级物理极限时，摩尔定律撞上了“物理墙”（如量子隧穿、漏电和寄生阻抗激增导致时延恶化）和“经济墙”（先进制程研发与流片成本呈指数级暴增，3nm以下制程经济效益崩塌）。 2. **韬（$\\tau$）定律（时间延迟驱动）**： * **核心逻辑**：主张以“时间（$\\tau$）缩微”（Time Scaling）替代传统的“几何缩微”。它将“时间”作为贯穿器件、电路、芯片和系统的统一物理度量，通过多层级协同设计，系统性地压缩信号传播延迟、时钟建立时间和通信开销。 * **演进关系**：韬定律不是对摩尔定律的否定，而是在其面临物理与经济极限时的“换道超车”。它打破了“只有物理尺寸变小，芯片才能变快”的路径依赖。在成熟制程（如28nm、14nm或7nm）的基础上，通过对时间常数 $\\tau \= R \\cdot C$ 中的电阻 $R$ 和电容 $C$ 进行系统性优化，依然能获得等效于极先进制程（如1.4纳米）的等效晶体管密度和系统级能效。### **二、韬定律与2.5D/3D堆叠技术的关系：从“粗粒度拼装”到“深层逻辑折叠”**在半导体物理空间从“平面（2D）”走向“立体（3D）”的技术浪潮中，现有的2.5D/3D堆叠技术是物理载体，而韬定律下的“逻辑折叠（LogicFolding）”和“3D Folding”是其走向高阶阶段的系统级演进。1. **传统2.5D/3D堆叠技术（粗粒度的功能级拼装）**： * 传统的2.5D堆叠（如台积电CoWoS）和3D堆叠，主要解决的是“异构集成”与“存储墙”问题。例如，通过中介层（Interposer）或硅通孔（TSV），将计算核心（CPU/GPU）与高带宽内存（HBM）紧挨着封装在一起。这属于**模块与模块之间（IP级）的物理级拼装**，信号传输距离虽然从板级缩短至微米级，但芯片内部的逻辑电路依然在各自的2D平面上运行。 2. **逻辑折叠LogicFolding（深粒度的电路关键路径折叠）**： * 韬定律核心的“逻辑折叠”技术，是**将3D堆叠与电路设计、架构协同进行深度融合的高阶系统优化**。 * 它摒弃了传统的2D平面布局，利用超高精度混合键合（Hybrid Bonding）技术，将电路关键路径上的逻辑功能单元进行**纵向折叠**。例如，原本在2D平面上水平排布、距离极长的时序逻辑链（寄存器 $\\to$ 组合逻辑 $\\to$ 寄存器），被垂直重构并堆叠成两层或多层，把上下两层当成一块连续的布线空间来设计。由于垂直互连通道的走线物理距离和寄生电阻、电容（RC）大幅降低，使得时钟频率得以显著提升（如2026年发布的麒麟手机芯片主频达到3.1 GHz）。 3. **3D Folding（攻克2.5D的面积带宽瓶颈）**： * 在传统的2.5D封装中，虽然裸片（Die）可以水平铺开，但随着计算核心面积增大，其边缘互连带宽的增速往往跟不上计算性能的需求（即遭遇边缘带宽墙）。 * 韬定律演进出的“3D Folding”则通过将存储、电源管理、光电I/O等组件直接重构并垂直布置到立体表面，实现计算、存储、传输的同构纵向扩展，从而彻底攻克了传统2.5D封装的面积和互连带宽瓶颈。### **总结**“韬定律”是方法论指导，而“逻辑折叠（LogicFolding）”及系统级“3D Folding”是其在三维物理空间中的具体技术落地。它们与传统堆叠技术的本质区别在于：**传统的2.5D/3D堆叠是将不同的芯片拼在一起，而基于韬定律的3D集成，是通过先进封装将一个芯片内的基本逻辑和关键路径重新垂直折叠、设计，使电路在物理立体空间中用最短的时间（最小的 $\\tau$）完成运算，从而绕过了对先进制程光刻设备的绝对依赖**。

11. SEMICON专题｜先进封装封神！后摩尔时代，国产力量领跑全球赛道半导体产业已正式进入“封装即系统”的新时代，而先进封装，正是改写全球产业格局的关键变量。SEMI现场发布的报告更给出了明确信号：2026年全球先进封装市场规模将达480亿美元，2030年将突破794亿美元，年复合增长率超15%。在AI算力爆发、国产替代深化的双重浪潮下，先进封装正迎来黄金发展期。#芯片先进封装# #国产芯片有望通过先进封装突围# SEMICON专题｜先进封装封神！后摩尔时代，国产力量领跑全球赛道

12. CoWoS之后，下一代先进封装会是CoPoS？

13. 华为芯片领域重大突破，谁可能受益？华为提出的韬(τ)定律=时间缩微+逻辑折叠+3D堆叠，绕开了EUV/纳米制程瓶颈，成熟制程（28/14nm）靠架构达到1.4nm等效密度这是中国首次定义半导体演进规则，全产业链国产替代加速、壁垒抬升、或将为华为半导体产业链甚至全球合作企业带来技术与地位的提升其中受益最大的公司及逻辑如下：1长电科技，先进封装绝对龙头，XDFOI、3D堆叠、Chiplet、逻辑折叠唯一量产能力；全球第三、国内第一，华为麒麟唯一核心封测商。国内唯一能量产逻辑折叠/3D堆叠高端芯片的封测厂，无直接竞品。麒麟芯片（2026秋）唯一封测供应商；381款华为芯片主力封测。逻辑折叠=3D堆叠=长电主场；韬定律落地完全依赖长电。2. 华大九天，EDA全流程垄断（卡脖子）国内唯一全流程EDA（电路/版图/验证）；逻辑折叠需要全新立体/双层版图，EDA不可替代。国产EDA市占90%+，华为唯一国产EDA供应商；全球仅Synopsys/Cadence/华大九天三家全流程。韬定律芯片设计唯一国产工具；381款芯片+新麒麟全用华大九天。3. 中芯国际，成熟制程代工核心N+1/N+2（类7nm）成熟制程；逻辑折叠不需要EUV，中芯产能完全匹配。大陆唯一能量产华为高端芯片的晶圆厂；28/14nm产能最大。华为381款芯片+新麒麟唯一代工厂。4. 通富微电，先进封装第二2.5D/3D异构封装、Chiplet；华为二供，逻辑折叠备用产能。国内第二大先进封装，AMD+华为双核心客户，麒麟订单放量5. 回天新材，先进封装材料（国产替代）底部填充胶(Underfill)、3D封装胶；打破日本垄断，华为唯一国产胶供应商。国内唯一3D封装全系列胶粘剂；麒麟芯片底部填充胶唯一供应商。6. 芯原股份，IP核（逻辑折叠核心）高密度逻辑IP、短时序优化、可重构IP；适配逻辑折叠并行架构。国内最大半导体IP供应商，华为海思核心IP伙伴。#华为半导体领域新突破##华为高管回应半导体领域新突破##华为逻辑折叠技术#

14. 下周一，热点板块龙头有哪些？第1个。特高压。电科院，西高院，派瑞股份、红相股份，汉缆股份，思源电气。积成电子，中国电建。白云电器，华明装备第2个。光刻机，美埃科技，华辰装备，富创精密，中润化学，洪田股份，中瓷电子。百傲化学第3个。国家大基金持股，百维存储，精测电子、江波龙、华润微，三安光电。通富微电、燕东微，兴福电子，中科飞测，艾森股份。第4个。减速器，德恩精工，恒工精密，德迈仕，斯菱智驱，五洲新春。艾迪精密，绿的谐波，美利信，浙江荣泰，步科股份，力星股份，海昌新材第5个。人形机器人，恒辉安防，恒工精密，德迈仕、宁波华翔、方正电机、信质集团。九鼎投资。沃尔德，浙江荣泰第6个。固态电池。西高院，科森科技，可川科技，联科科技、美利信，洪田股份，奥特维。聚杰微纤，洁美科技，万向钱潮。泰和科技。大族激光第7个。半导体。凯德石英，天岳先进，甬矽电子。汇成股份，蓝箭电子。康强电子。金海通。星宸科技。兆易创新，长电科技、康强电子第8个。光伏设备。宇邦新材，晶盛机电，钧达股份，迈为股份，弘元绿能。东方日升，帝科股份。阳光电源第9个。电网设备，新风光，广电电气，森源电气，日丰股份。宏盛华源，新能泰山、万胜智能。煜邦电力、华菱线缆。风范股份，新联电子第10个。汽车零部件。恒帅股份，动力新科、宁波华翔、海安集团、信质集团，新泉股份，三角轮胎。威唐工业，富特科技，维科精密第11个，稀土永磁，宇晶股份。中国铀业，祥明智能，龙磁科技，华新环保，厦门钨业。金力永磁，正海磁材，银河磁体，争光股份第12个，工程机械。铁拓机械，艾迪精密，恒立钻具，唯万密封，恒立液压、中力股份，南方路机，诺力股份。杭叉集团，安徽合力，作者提示，素材来源于网络，个人复盘整理，不构成任何投资依据，如有雷同，纯属巧合，请易跟风。谢谢。

15. PCIM Asia 2025观察：那些关于芯片内嵌PCB封装技术的前瞻故事

16. 台积电在嘉义设2座CoWos先进封装厂，此前该厂区发生多安全事件导致停工，但仅有部分工区停工，对进度影响不大。据透露，目前二厂已装机测试，预计明年投入量产，一厂预计明年装机，后年投入量产，据了解，未来还将扩厂设约6座3D先进封装厂。

17. 长电科技：先进封装龙头长期成长逻辑与核心价值研判一、核心研判结论长电科技作为国内封测绝对龙头，正处于周期底部反转+产业技术迭代+成长属性重构的关键拐点。公司依托先进封装高景气赛道、全球领先的技术产能与优质客户壁垒，中长期成长逻辑扎实、增量路径清晰。二、中长期成长核心逻辑（一）产业格局迭代，先进封装开启黄金周期后摩尔时代下，芯片性能提升不再依赖制程微缩，而是依靠Chiplet、2.5D/3D堆叠、HBM异构集成实现突破。先进封装从产业配套环节升级为半导体核心价值环节，毛利率、技术壁垒、市场空间全面超越传统封测。叠加AI算力、高端存储、汽车电子持续爆发，全球先进封装行业进入25%以上增速的长景气周期。同时国内半导体自主可控进程加速，封测作为国内唯一达到全球第一梯队的环节，龙头集中度持续提升。（二）龙头壁垒深厚，核心竞争力难以复制1. 全球行业地位领先：国内封测第一、全球第三，规模壁垒与行业话语权稳固，充分受益行业集中度提升。2. 高端技术国内独一档：掌握HBM3E、XDFOI多维异构集成、硅光CPO等核心工艺，良率对标国际巨头，是国内唯一实现高端先进封装大规模量产企业。3. 全球顶级客户绑定：深度覆盖英伟达、AMD、SK海力士、华为、车规头部企业，订单能见度高，业绩基本盘极其扎实。4. 前瞻产能锁定增量：百亿级资本开支持续落地，产能全部投向高毛利先进封装与车规级产线，提前锁定未来三年业绩增长。（三）多赛道共振，成长持续迭代1. AI先进封装（核心主升浪）：高毛利核心资产，业务占比持续抬升，带动公司整体盈利中枢上移，完成从周期到成长的转型。2. HBM存储封装（高弹性增量）：存储行业周期反转叠加AI高带宽需求爆发，业务增速显著，提供极强业绩弹性。3. 车规半导体封装：汽车智能化持续渗透，车规高端封装产能放量，平滑半导体行业周期波动，筑牢长期稳健底盘。三、企业中长期核心价值解析（一）业绩价值：公司业务结构不断优化，高毛利先进业务占比稳步提升。未来三年在产能释放、结构升级、赛道高景气三重驱动下，净利润有望持续稳步扩容，业绩成长确定性高、持续性强。（二）估值价值：公司传统周期属性逐步弱化，科技成长属性持续强化。行业赛道升级叠加盈利能力改善，公司将彻底摆脱传统封测低估值区间，进入业绩增长+估值修复的双击阶段。（三）产业价值：半导体战略资产长电科技是国内先进封装领域最具全球竞争力的硬核资产，承担高端芯片封装自主可控任务，补齐国内半导体产业链关键短板，属于政策扶持、产业刚需的核心龙头企业。四、中长期风险因素公司为重资产扩张模式，持续资本开支带来阶段性折旧与现金流压力；海外营收占比较高，存在地缘政策扰动风险；行业扩产加剧中长期竞争，短期高位估值易引发资金震荡。以上风险仅影响短期波动，不破坏长期成长主线。五、最终综合研判短期：情绪分歧主导，行情震荡中期：产能释放+业绩稳步抬升。长期：受益先进封装时代红利，完成从周期封测企业向全球高端半导体解决方案龙头的蜕变。整体来看，长电科技赛道顶级、壁垒深厚、增量明确、价值重估空间大，是半导体先进封装赛道最优长期配置标的之一。风险提示！本文根据市场信息整理复盘，不构成任何投资建议。

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23. 不止EUV光刻机：ASML计划进军先进封装赛道。看到这个消息，我感慨万千。以前ASML靠光刻机称霸全球。现在它也要做先进封装了。为什么？因为AI芯片太火了。传统光刻机已经不够用了。封装技术成为新的战场。这就是芯片行业的趋势：单点突破不够了。要全链路布局。才能赢。#ASML##光刻机##AI##芯片##半导体#

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