SWCNT 铁电晶体管阵列：超高温探针台INSTEC用一维半导体

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在传统硅基 CMOS scaling 逼近物理级限、AI 与物联网数据爆发式增长的背景下，"可重构器件"正在成为一个热门解药——同一只晶体管能在 p 型和 n 型之间动态切换，用更少的器件数实现同等电路功能，从而缓解面积与功耗压力。但此前的可重构方案大多依赖额外编程栅级 + 持续电压维持，反而削弱了"省面积、低功耗"的初衷。宾大 Deep Jariwala 组与成均馆大学 Joohoon Kang 组联合在 arXiv 2411.03198 中抛出一种新的解法：把高度取向的单壁碳纳米管（SWCNT）单层沟道与铁电 Al₀.₆₈Sc₀.₃₂N 栅介质集成，做出单栅结构的可重构 FeFET 阵列，厘米级（~1 cm²）上集成约 735 个器件，且 p/n 切换、非易失存储、TCAM 应用一把抓，全文亮点值得拆开看。

为什么是 SWCNT + AlScN？

可重构 FET 的老大难有两个：一是沟道材料，硅纳米线要么 bottom-up 不可控、要么 top-down 工艺复杂，而且硅的电子/空穴有效质量差太大，双级性（ambipolar）电流很难平衡；二是栅结构，以往要"编程栅"持续加电来维持级性，功耗扛不住。

这支团队选的材料组合针对性很强：

SWCNT 单层沟道：近乎相等的电子/空穴有效质量，天然适合双级性；99.9999% 半导体纯度已可溶液规模化制备；且与 CMOS 后端线（BEOL）<400°C 热预算兼容，能单片集成在硅上方。

Al₀.₆₈Sc₀.₃₂N 铁电栅介质：纤锌矿结构，剩余级化 >100 μC/cm²，比主流 HZO 高出一个量级；同样 BEOL 兼容（350°C 脉冲 DC 共溅射）。铁电自发级化是非易失的——编程完不用持续加电，单栅就能锁住 p/n 级性，省掉额外编程栅。

器件结构与工艺要点

器件是背栅 FeFET 架构：Pt/Ti/SiO₂/Si 衬底上外延 45 nm AlScN（纤锌矿相），再把界面限域浸涂得到的致密、高度取向 SWCNT 单层（平均直径 1.5 nm，Raman D/G⁺ 仅 0.02，缺陷级少）用 PMMA 辅助湿法转移到 AlScN 上，沟道方向平行于 SWCNT 取向以保证高电流密度。源漏用电子束光刻定义，沟长 500 nm、沟宽 20 μm 起。

关键巧思在接触金属工程——通过费米级位置调控级性：

高功函数 Au（5.1 eV）/Pd（5.2 eV）：费米级低于 SWCNT 价带（-4.75 eV），做出干净的 p-FeFET，±15 V 扫幅下记忆窗口 10.4–11.9 V，Iₒₙ/Iₒff 达 2.6×10⁵–4.4×10⁵。

近中功函数 Cr（4.5 eV）：功函数贴近 SWCNT 中隙，做出双级性 FeFET——空穴侧记忆窗口 11.0 V、电子侧 3.5 V，两侧 Iₒₙ/Iₒff 均 ~10⁵ 量级；空穴和电子导通的开启电流密度在 |V_DS|=3 V 时都做到 ~270 μA/μm，对称性几乎完每。

对照组 Ti：会和 SWCNT 反应破坏界面，双级性没做出来，电流还掉了两个量级——证明 Cr 是这类器件接触的zui优解。

对照实验也补得很扎实：同样 SWCNT 换 50 nm SiO₂ 做普通 FET，迟滞变成电荷陷阱型的逆时针方向，反过来印证 AlScN 的铁电翻转才是 FeFET 迟滞的主因。

阵列均匀性与可靠性

SWCNT 和 AlScN 都是可晶圆级扩展的工艺，团队在 ~1 cm² 阵列里测了数百个 Cr 接触双级性器件：

空穴侧记忆窗口均值 11.8 V（σ=0.9 V），电子侧 3.8 V（σ=0.6 V）

高低阻态电流比（I_LRS/I_HRS）空穴侧 ~4.7×10⁴、电子侧 ~3.0×10⁵

保持特性：±15 V、1 s 脉编程后，10⁴ s 内 LRS/HRS 均稳定

当 NVM 用没问题，反复 p↔n 重构 100 周期，Iₒₙ/Iₒff 始终保持在 3×10³ 以上，够数字电路门槛。

横向比一下：这支团队的 SWCNT/AlScN FeFET，空穴和电子开启电流密度都超过了此前报道的所有双级性 FeFET（含 14 nm 节点 HZO FinFET、WSe₂/AlScN 等），电子侧比当前 SOTA 的 WSe₂/AlScN 还高 4 倍多——一维材料在输运上的优势确实碾压二维和体硅。

可重构的价值落地：单器件 TCAM

可重构zui性感的落点是三态内容寻址存储器（TCAM）——传统硅 CMOS TCAM 一个单元要 10+ 只晶体管；RRAM/PCM/单级性 FeFET 方案压到 2–4 组件；而这篇用单只双级性 SWCNT FeFET 就能做一个 TCAM 核心单元，外圈配一只 PMOS + 预充电电容即可。